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HDL tutorials

HDL languages are nowadays the preferred way to create FPGA designs. The most commonly used HDL languages are Verilog and VHDL. This site showns examples in Verilog, but VHDL could have been used, as they are equivalent for most purposes.

   到底是选择VHDL还是Verilog HDL ,这个一直是争论,如过你是初学者,有C的工程经验,建议你学Verilog HDL,使用哪种语言完全看你的习惯。使用哪种语言还要看提供IP的厂商,市场和商业利益等因素。先学习一种精通他,另外一种就简单了,不过高兴的是先在FPGA的声场商机被是支持混合编程,不过一般还是建议使用单一的HDL语言,那样更有好处。

    选择哪种语言不重要,重要的是思路,有好的想法,那才是最重要的!当然也要关注新的硬件描述语言的发展,system C和system verilog是未来的编程呢个语言,更高层次的抽象,就像C++和C的关系一样。做为一名好的程序员不仅要专一,善始善终,有很强的坚持的精神,同时也要有很好的学习能力。不管怎样,都要坚持做下去,这样你才能有所提高。

Here are a few tutorials:

Finally Testbench.in with Verilog, Systemverilog, OpenVera, VMM, RVM, AVM, OVM tutorials.

 

 

 

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